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stm32f407系列微控制器基礎知識

簡介pdf本文是基於stm32f407zgt6微控制器做出介紹stm32系列微控制器是stc公司開發並設計出的一類高速低功耗晶片,其具有眾多可用內部資源,在下文將一一介紹1:本晶片共有144引腳其中有大部分IO口都耐 5V (模擬通道除外)2:

微控制器dma是什麼

參考stc公司標準開發手冊 STM32F4xx中文參考手冊1。pdf

本文是基於stm32f407zgt6微控制器做出介紹

stm32系列微控制器是stc公司開發並設計出的一類高速低功耗晶片,其具有眾多可用內部資源,在下文將一一介紹

stm32f407系列微控制器基礎知識

1:本晶片共有144引腳其中有大部分IO口都耐 5V (模擬通道除外)

2:支援除錯: SWD和JTAG,SWD只要2根資料線

3:大部分IO口有第二,或第三功能功能較多

stm32f407系列微控制器基礎知識

特性:

1、核心:帶有 FPU 的 ARM® 32 位 Cortex®-M4CPU、在 Flash 儲存器中實現零等待狀態執行效能的自適應實時加速器 (ART 加速器 ™)、主頻高達 168MHz, MPU,能夠實現高達210 DMIPS/1。25DMIPS/MHz (Dhrystone 2。1)的效能,具有 DSP 指令集。,高達1 MB的快閃記憶體(Flash),增加了乙太網MAC和照相機介面

2:多達 140 個具有中斷功能的 I/O 埠

– 高達 136 個快速 I/O,最高 84 MHz

– 高達 138 個可耐 5 V 的 I/O

3:儲存器

– 高達1 MB Flash

– 高達 192+4 KB的SRAM, 包括64-KB的CCM(核心耦合儲存器)資料 RAM

– 具有高達 32 位資料匯流排的靈活外部儲存控制器: SRAM、 PSRAM、 NOR/NAND儲存器

4:時鐘、復位和電源管理

(1)1。8~3。6V電源和IO電壓

(2)上電覆位,掉電覆位和可程式設計的電壓監控

(3)強大的時鐘系統

- 4~26M的外部高速晶振

- 內部16MHz的高速RC振盪器

- 內部鎖相環(PLL,倍頻),一般系統時鐘都是外部或者是內部高速時鐘經過PLL倍頻後得到

- 外部低速32。768K的晶振,主要做RTC時鐘源

5:多種工作模式可供選擇

(1)睡眠、停止和待機三種低功耗模式

(2)可用電池為RTC和備份暫存器供電

6:AD通道

(1)3 個 12 位、 2。4 MSPS ADC:多達 24 通道,三重交叉模式下的效能高達 7。2 MSPS

(2)內部通道可以用於內部溫度測量

7:DA

2個12位DA轉換器

8:通用DMA:具有FIFO和突發支援的16路DMA控制器

9:多達17個定時器: 12個16位定時器,和2個頻率高達 168 MHz 的 32 位定時器,每個定時器都帶有 4 個輸入捕獲 / 輸出比較 /PWM,或脈衝計數器與正交 ( 增量 ) 編碼器輸入

10:通訊介面:多達 15 個通訊介面

– 多達 3 個 I2C 介面 (SMBus/PMBus)

– 高達 4 個 USART/4 個 UART( 10。5 Mbit/s、ISO7816介面、 LIN、 IrDA、 調變解調器控制)

– 高達 3 個 SPI ( 42 Mbits/s), 2 個具有複用的全雙工 I2S, 透過內部音訊 PLL 或外部時鐘達到 音訊級精度

– 2 個 CAN ( 2。0B 主動)以及 SDIO 介面

– 2個USB OTG

11:內建看門狗系統,分為獨立看們狗和視窗看門狗

12:程式下載支援J-Link和串列埠下載器

當使用串列埠下載器是系統執行模式BOOT0與BOOT1要做出相應修改

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13:系統架構

主系統由 32 位多層 AHB 匯流排矩陣構成,可實現以下部分的互連:

● 八條主控匯流排:

— Cortex™-M4F 核心 I 匯流排、D 匯流排和 S 匯流排

— DMA1 儲存器匯流排

— DMA2 儲存器匯流排

— DMA2 外設匯流排

— 乙太網 DMA 匯流排

— USB OTG HS DMA 匯流排

● 七條被控匯流排:

— 內部 Flash ICode 匯流排

— 內部 Flash DCode 匯流排

— 主要內部 SRAM1 (112 KB)

— 輔助內部 SRAM2 (16 KB)

— 輔助內部 SRAM3 (64 KB)(僅適用於 STM32F42xxx 和 STM32F43xxx 器件)

— AHB1 外設(包括 AHB-APB 匯流排橋和 APB 外設)

— AHB2 外設

— FSMC

藉助匯流排矩陣,可以實現主控匯流排到被控匯流排的訪問,這樣即使在多個高速外設同時執行期間,系統也可以實現併發訪問和高效執行

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內部資源對應圖

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引腳對應

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